数字电子技术课后题答案

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第1单元 能力训练检测题 （共100分，120分钟）

一、填空题：（每空0.5分，共20分）

1、由二值变量所构成的因果关系称为 逻辑 关系。能够反映和处理 逻辑 关系的数学工具称为逻辑代数。

2、在正逻辑的约定下，“1”表示 高 电平，“0”表示 低 电平。

3、数字电路中，输入信号和输出信号之间的关系是 逻辑 关系，所以数字电路也称为 逻辑 电路。在 逻辑 关系中，最基本的关系是 与逻辑 、 或逻辑 和 非逻辑 。

4、用来表示各种计数制数码个数的数称为 基数 ，同一数码在不同数位所代表的 权 不同。十进制计数各位的 基数 是10， 位权 是10的幂。

5、 8421 BCD码和 2421 码是有权码； 余3 码和 格雷 码是无权码。 6、 进位计数制 是表示数值大小的各种方法的统称。一般都是按照进位方式来实现计数的，简称为 数 制。任意进制数转换为十进制数时，均采用 按位权展开求和 的方法。

7、十进制整数转换成二进制时采用 除2取余 法；十进制小数转换成二进制时采用 乘2取整 法。

8、十进制数转换为八进制和十六进制时，应先转换成 二进 制，然后再根据转换 的 二进 数，按照 三个数码 一组转换成八进制；按 四个数码 一组转换成十六进制。

9、逻辑代数的基本定律有 交换 律、 结合 律、 分配 律、 反演 律和 非非 律。 10、最简与或表达式是指在表达式中 与项中的变量 最少，且 或项 也最少。 13、卡诺图是将代表 最小项 的小方格按 相邻 原则排列而构成的方块图。卡诺图的画图规则：任意两个几何位置相邻的 最小项 之间，只允许 一位变量 的取值不同。

14、在化简的过程中，约束项可以根据需要看作 1 或 0 。 二、判断正误题（每小题1分，共10分）

1、奇偶校验码是最基本的检错码，用来使用PCM方法传送讯号时避免出错。（ 对 ） 2、异或函数与同或函数在逻辑上互为反函数。 （ 对 ） 3、8421BCD码、2421BCD码和余3码都属于有权码。 （ 错 ） 4、二进制计数中各位的基是2，不同数位的权是2的幂。 （ 对 ） 3、每个最小项都是各变量相“与”构成的，即n个变量的最小项含有n个因子。（ 对 ） 4、因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。 （ 错 ） 5、逻辑函数F=AB+AB+BC+BC已是最简与或表达式。 （ 错 ） 6、利用约束项化简时，将全部约束项都画入卡诺图，可得到函数的最简形式。（ 错 ） 7、卡诺图中为1的方格均表示逻辑函数的一个最小项。 （ 对 ）


8、在逻辑运算中，“与”逻辑的符号级别最高。 （ 对 ） 9、标准与或式和最简与或式的概念相同。 （ 对 ） 10、二极管和三极管在数字电路中可工作在截止区、饱和区和放大区。 （ 错 ） 三、选择题（每小题2分，共20分）

1、逻辑函数中的逻辑“与”和它对应的逻辑代数运算关系为（ B ）。

A、逻辑加 B、逻辑乘 C、逻辑非 2．、十进制数100对应的二进制数为（ C ）。

A、 B、 C、 D、

3、和逻辑式AB表示不同逻辑关系的逻辑式是（ B ）。

A、AB B、A•B C、A•BB D、ABA 4、数字电路中机器识别和常用的数制是（ A ）。

A、二进制 B、八进制 C、十进制 D、十六进制 5、以下表达式中符合逻辑运算法则的是（ D ）。

A、C·C=C2 B、1+1=10 C、0<1 D、A+1=1 6、A+BC=（ C ）。

A、A+B B、A+C C、（A+B）（A+C） D、B+C 7、在（ D ）输入情况下，“与非”运算的结果是逻辑0。

A、全部输入是0 B、任一输入是0 C、仅一输入是0 D、全部输入是1 8、逻辑变量的取值１和０可以表示（ ABCD ）。

A、开关的闭合、断开 B、电位的高、低 C、真与假 D、电流的有、无 9、求一个逻辑函数F的对偶式，可将F中的（ ABD ）。

A .“·”换成“+”，“+”换成“·” B、原变量换成反变量，反变量换成原变量 C、变量不变 D、常数中“0”换成“1”，“1”换成“0” 10、在（ BCD ）输入情况下，“或非”运算的结果是逻辑0。 A、全部输入是0 B、全部输入是1 C、任一输入为0，其他输入为1 D、任一输入为1 四、简述题（每小题4分，共16分） 1、逻辑代数与普通代数有何异同？

答：逻辑代数中仅含有0和1两个数码，普通代数含有的数码是0～9个，逻辑代数是逻辑运算，普通代数是加、减、乘、除运算。

2、什么是最小项？最小项具有什么性质？

答：一个具有n个逻辑变量的与或表达式中，若每个变量以原变量或反变量形式仅出现一次，就可组成2n个“与”项，我们把这些“与”项称为n个变量的最小项，分别记为

1


mn。最小项具备下列性质：

①对于任意一个最小项，只有一组变量取值使它的值为1,而变量取其余各组值时，该最小项均为0。

②任意两个不同的最小项之积恒为0。 ③变量全部最小项这和恒等于1。

3、在我们所介绍代码范围内，哪些属于有权码？哪些属于无权码？ 答：8421BCD码和2421BCD码属于有权码，余3码和格雷码属于无权码。 4、试述卡诺图化简逻辑函数的原则和步骤。 答：利用卡诺图化简逻辑函数式的步骤： ①根据变量的数目，画出相应方格数的卡诺图； ②根据逻辑函数式，把所有为“1”的项画入卡诺图中；

③用卡诺圈把相邻最小项进行合并，合并时就遵照卡诺圈最大化原则；

④根据所圈的卡诺圈，消除圈内全部互非的变量，每一个圈作为一个“与”项，将各“与”项相或，即为化简后的最简与或表达式。

五、计算题（共34分）

1、用代数法化简下列逻辑函数（12分）

①F(AB)CAB

F(AB)CAB

解：

ACBCABCABABCAB



②FACABBC

FACABBC

解：

ACBCAACB



③FABCABCABCABCABC 解：

FABCABCABCABCABCABABAC



④FABBCDCDABCACD

FABBCDCDABCACD

解：

ABACCDBCABABCABCCDBCABCDBC



2


2、用卡诺图化简下列逻辑函数（8分）

①Fm(3,4,5,10,11,12)d(1,2,13) 卡诺图略

Fm(3,4,5,10,11,12)d(1,2,13)BCBCACD

②F(ABCD)m(1,2,3,5,6,7,8,9,12,13)

F(ABCD)m(1,2,3,5,6,7,8,9,12,13)ACCDAC

1, 6, 7, 8, 12, 14, 15）m(0，

F(A、 B、C 、D)m(0， 1, 6, 7, 8, 12, 14, 15）ABCACDBC ④F(A、 B、C 、D)m(0， 1, 5, 7, 8, 14, 15）d(3, 9, 12）F(A、 B、C 、D)m(0， 1, 5, 7, 8, 14, 15）d(3, 9, 12）BCADABC③F(A、 B、C 、D)

3、完成下列数制之间的转换（8分）

①（365）10＝（ ）2＝（555 ）8＝（16D ）16 ②（11101.1）2＝（29.5）10＝（ 35.4）8＝（1D.8）16 ③（57.625）10＝（(.101)2=71.5 ）8＝（ 39.A ）16 4、完成下列数制与码制之间的转换（6分） ①（47）10＝（ ）余3码＝（ ）8421码 ②（3D）16＝（ ）格雷码

③（25.25）10＝（ . ）8421BCD＝（.）2421BCD＝（31.2）8

第2单元 能力训练检测题 （共100分，120分钟）

一、填空题：（每空0.5分，共23分）

1、基本逻辑关系的电路称为 逻辑门 ，其中最基本的有 与门 、 或门 和 非 门。常用的复合逻辑门有 与非 门、 或非 门、 与或非 门、 异或 门和 同或 门。

2、TTL集成电路的子系列中，74S表示 肖特基 系列，74L表示 低功耗 系列、74LS表示 低功耗肖特基 系列。

3、CMOS集成电路是由 增强 型 PMOS 管和 增强 型 NMOS 管组成的互补对称MOS门电路，其中CC4000系列和 高速 系列是它的主要子系列。

4、功能为“有0出1、全1出0”的门电路是 与非 门；具有“ 有1出1，全0出0 ”功能的门电路是或门；实际中集成 与非 门应用的最为普遍。

5、普通的TTL与非门具有 图腾 结构，输出只有 高电平“1” 和 低电平“0” 两种状态；TTL三态与非门除了具有 1 态和 0 态，还有第三种状态 高阻 态，三态门可以实现 总线 结构。

6、集成电极开路的TTL与非门又称为 OC 门，其输出可以 “线与 。

7、TTL集成电路和CMOS集成电路相比较， TTL 集成门的带负载能力较强， CMOS 集成门的抗干扰能力较强。

8、两个参数对称一致的一个 NMOS 管和一个 PMOS 管，并联可构成一个CMOS

3


传输门。两管源极相连构成传输门的 （输入端）或输出 端，两管漏极相连构成传输门的 （输出端）或输入 端，两管的栅极分别与两个互非的 控制 端相连。

9、具有图腾结构的TTL集成电路，同一芯片上的输出端，不允许 并 联使用；同一芯片上的CMOS集成电路，输出端可以 并 联使用，但不同芯片上的CMOS集成电路上的输出端是不允许 并 联使用的。

10、当外界干扰较小时，TTL 与非 门闲置的输入端可以 悬空 处理；TTL 或非 门不使用的闲置输入端应与 地 相接；CMOS门输入端口为“与”逻辑关系时，闲置的输入端应接 高 电平，具有“或”逻辑端口的CMOS门多余的输入端应接 低 电平；即CMOS门的闲置输入端不允许 悬空 。 二、判断正误题（每小题1分，共10分）

1、所有的集成逻辑门，其输入端子均为两个或两个以上。 （ 错 ） 2、根据逻辑功能可知，异或门的反是同或门。 （ 对 ） 3、具有图腾结构的TTL与非门可以实现“线与”逻辑功能。 （ 错 ） 4、逻辑门电路是数字逻辑电路中的最基本单元。 （ 对 ） 5、TTL和CMOS两种集成电路与非门，其闲置输入端都可以悬空处理。 （ 错 ） 6、74LS系列产品是TTL集成电路的主流，应用最为广泛。 （ 对 ） 7、74LS系列集成芯片属于TTL型，CC4000系列集成芯片属于CMOS型。（ 对 ） 8、三态门采用了图腾输出结构，不仅负载能力强，且速度快。 （ 错 ） 9、OC门可以不仅能够实现“总线”结构，还可构成与或非逻辑。 （ 对 ） 10、CMOS电路的带负载能力和抗干扰能力均比TTL电路强。 （ 错 ） 三、选择题（每小题2分，共16分）

1、具有“有1出0、全0出1”功能的逻辑门是（ B ）。

A、与非门 B、或非门 C、异或门 D、同或门 2、两个类型的集成逻辑门相比较，其中（ B ）型的抗干扰能力更强。

A、TTL集成逻辑门 B、CMOS集成逻辑门 3、CMOS电路的电源电压范围较大，约在（ B ）。

A、－5V~＋5V B、3~18V C、5~15V D、＋5V

4、若将一个TTL异或门当做反相器使用，则异或门的A和B输入端应：（ A ）。

A、B输入端接高电平，A输入端做为反相器输入端 B、B输入端接低电平，A输入端做为反相器输入端 C、A、B两个输入端并联，做为反相器的输入端 D、不能实现

5、（ C ）的输出端可以直接并接在一起，实现“线与”逻辑功能。

A、TTL与非门 B、三态门 C、OC门

4


6、（ A ）在计算机系统中得到了广泛的应用，其中一个重要用途是构成数据总线。

A、三态门 B、TTL与非门 C、OC门

7、一个两输入端的门电路，当输入为1 0时，输出不是1的门电路为（ C ）。

A、与非门 B、或门 C、或非门 D、异或门

8、一个四输入的与非门，使其输出为0的输入变量取值组合有（ B ）。

A、15种 B、1种 C、3种 D、7种

四、简述题（每小题4分，共24分）

1、数字电路中，正逻辑和负逻辑是如何规定的？

答：数字电路中只有高、低电平两种取值。用逻辑“1”表示高电平，用逻辑“0”表示低电平的方法称为正逻辑；如果用用逻辑“0”表示高电平，用逻辑“1”表示低电平，则称为负逻辑。

2、你能说出常用复合门电路的种类吗？它们的功能如何？

答：常用的复合门有与非门、或非门、与或非门、异或门和同或门。其中与非门的功能是“有0出1，全1出0”；或非门的功能是“有1出0，全0出1”；与或非门的功能是“只要1个与门输出为1，输出为0，两个与门全部输出为0时，输出为1”；异或门的功能是“相异出1，相同出0”；同或门的功能是“相同出1，相异出0”。

3、TTL与非门闲置的输入端能否悬空处理？CMOS与非门呢？

答：TTL与非门闲置的输入端一般也不要悬空处理，但当外界干扰较小时，就可以把闲置的输入端悬空处理；而CMOS与非门闲置的输入端是不允许悬空处理的。

4、试述图腾结构的TTL与非门和OC门、三态门的主要区别是什么？

答：图腾结构的TTL与非门采用的推挽输出，通常不允许将几个同类门的输出端并联起来使用，正常情况下，图腾结构TTL与非门输出对输入可实现与非逻辑；集电极开路的TTL与非门又称为OC门，多个OC门的输出端可以并联起来使用，实现“线与”逻辑功能，还可用作与或非逻辑运算等；三态门和图腾结构的TTL与非门相比，结构上多出了一个使能端，让使能端处有效状态时，三态门与图腾结构TTL与非门功能相同，若使能端处无效态，则三态门输出呈高阻态，这时无论输入如何，输出均为高阻态。基于三态门的特点，广泛应用于计算机的总线结构。

5、如果把与非门、或非门、异或门当做非门使用时，它们的输入端应如何连接？ 答：如果把与非门做非门使用，只需将与非门的输入端并联起来即可；如果把或非门当做非门使用，只需把其它输入端子接地，让剩余的一个输入端作为非门输入即可；如果把异或门当做非门使用，只需把其它输入端子接高电平，让剩余的一个输入端作为非门输入即可。

6、提高CMOS门电路的电源电压可提高电路的抗干扰能力，TTL门电路能否这样做？为什么？

5


答：TTL门电路是不能采取提高电源电压的方式来提高电路抗干扰能力的。因为，TTL集成电路的电源电压是特定的，其变化范围很窄，通常在4.5～5.5V。 五、分析题（共27分）

1、已知输入信号A、B的波形和输出Y1、Y2、Y3、Y4的波形，试判断各为哪种逻辑门，并画出相应逻辑门图符号,写出相应逻辑表达式。（12分）

解：观察图示波形，判断出Y1

是与门；Y2是异或门；Y3是与非门；Y4是同或门。它们相应的图符号如下： A & B Y1＝AB

A B

=1

Y2

A B

=1

Y4

Y1

A B

& Y3＝AB

Y3

A B Y1 Y2 Y3 Y4

图2.46 2.5.1检测题波形图

t t t t t t



Y2＝A⊕B

Y4＝A⊕B

2、电路如图2.47（a）所示，其

输入变量的波形如图（b）所示。试判断图中发光二极管在哪些时段会亮。（7分）

L

A

B C D

图2.47 检测题2.5.2电路与波形图

解：由电路图可得，当L为低电平时，发光二极管会亮，图中



LAB•CDABCD

列真值表分析：

6


A 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1

B 0 0 0 0 1 1 1 1 0 0 0 0 1 1 1

C 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1

D 0 1 0 1 0 1 0 0 0 1 0 1 0 1 0

AB 0 0 0 0 0 0 0 0 0 0 0 0 1 1 1 1

CD 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 1

L 1 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0

1 1 1 1 发光管在t1～t2期间、t5～t6期间会亮。

3、试写出图2.48所示数字电路的逻辑函数表达式，并判断其功能。（8分）



解：电路的逻辑函数表达式为：

FAB•AC•BCABACBC

列真值表：

A

7

B C F


0 0 0 0 1 1 1 1

0 0 1 1 0 0 1 1

0 1 0 1 0 1 0 1

0 0 0 1 0 1 1 1

输入变量中有两个或两个以上为1时，输出才为1，因此电路功能为多数表决器电路。

第3单元 能力训练检测题 （共100分，120分钟）

一、填空题：（每空0.5分，共10分）

1、能将某种特定信息转换成机器识别的 二进 制数码的 组合 逻辑电路，称之为 编码 器；能将机器识别的 二进 制数码转换成人们熟悉的 十进 制或某种特定信息的 组合 逻辑电路，称为 译码 器；74LS85是常用的 组合 逻辑电路 译码 器。

2、在多数数据选送过程中，能够根据需要将其中任意一路挑选出来的电路，称之为 数据选择 器，也叫做 多路 开关。

3、74LS147是 10 线— 4 线的集成优先编码器；74LS148芯片是 8 线— 3 线的集成优先编码器。

4、74LS148的使能端S 为低电平 时允许编码；当S 1 时各输出端及OE、GS

均封锁，编码被禁止。

5、两片集成译码器74LS138芯片级联可构成一个 4 线— 16 线译码器。 6、LED是指 半导体 数码管显示器件。 二、判断正误题（每小题1分，共8分）

1、组合逻辑电路的输出只取决于输入信号的现态。 （ 对 ） 2、3线—8线译码器电路是三—八进制译码器。 （ 错 ） 3、已知逻辑功能，求解逻辑表达式的过程称为逻辑电路的设计。 （ 对 ） 4、编码电路的输入量一定是人们熟悉的十进制数。 （ 错 ） 5、74LS138集成芯片可以实现任意变量的逻辑函数。 （ 错 ） 6、组合逻辑电路中的每一个门实际上都是一个存储单元。 （ 错 ） 7、共阴极结构的显示器需要低电平驱动才能显示。 （ 错 ） 8、只有最简的输入、输出关系，才能获得结构最简的逻辑电路。 （ 对 ） 三、选择题（每小题2分，共14分）

1、下列各型号中属于优先编译码器是（ C ）。

8


A、74LS85 B、74LS138 C、74LS148 D、74LS48 2、七段数码显示管TS547是（ B ）。

A、共阳极LED管 B、共阴极LED管 C、共阳极LCD管 D、共阴极LCD管 3、八输入端的编码器按二进制数编码时，输出端的个数是（ B ）。

A、2个 B、3个 C、4个 D、8个 4、四输入的译码器，其输出端最多为（ D ）。

A、4个 B、8个 C、10个 D、16个

5、当74LS148的输入端I0~I7按顺序输入时，输出Y2~Y0为（ C ）。

A、101 B、010 C、001 D、110 6、译码器的输入量是（ A ）。

A、二进制 B、八进制 C、十进制 D、十六进制 7、编码器的输出量是（ A ）。

A、二进制 B、八进制 C、十进制 D、十六进制 四、简述题（每小题3分，共12分） 1、试述组合逻辑电路的特点？

答：组合逻辑电路的特点是：任意时刻，电路输出状态仅取决于该时刻的输入状态。 2、分析组合逻辑电路的目的是什么？简述分析步骤。

答：分析组合逻辑电路，目的就是清楚该电路的功能。分析步骤一般有以下几个步骤：①根据已知逻辑电路图写出相应逻辑函数式；②对写出的逻辑函数式进行化简。如果从最简式中可直接看出电路功能，则以下步骤可省略；③根据最简逻辑式写出相应电路真值表，由真值表输出、输入关系找出电路的功能；④指出电路功能。

3、何谓编码？二进制编码和二—十进制编码有何不同？

答：编码就是将人们熟悉的十进制数或某个特定信息用相应的高、低电平输入，使输出转换成机器识别的十进制代码的过程。二进制编码就是以自然二进制码进行代码编制，而二－十进制编码则是用多位二进制数码表示1位十进制数码的代码编制。

4、何谓译码？译码器的输入量和输出量在进制上有何不同？

答：译码就是把机器识别的二进制码译为人们熟悉的十进制码或特定信息的过程。以二－十进制译码为例，译码器的输入量是十进制代码，输出量是人们熟悉的十进制。

五、分析题（共16分）

1、根据表3-15所示内容，分析其功能，并画出其最简逻辑电路图。（6分） 表3-15 组合逻辑电路真值表

输 入 A B C 0 0 0

9

输 出

F 1


0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0 1 1 1

分析：从真值表输入、输出关系可写出相应逻辑函数式为： FABCABC



0 0 0 0 0 0 1

显然，电路输入相同时，输出才为1，否则为0。因此该电路是一个三变量一致电路。 2、写出图3.45所示逻辑电路的最简逻辑函数表达式。（10分）

A B C D

≥1

C

&

=1

F

A B

1

≥1

&

≥1

F

(a)

图3.45 检测3.5.2逻辑电路

分析：（a）图的逻辑函数式为：

(b)

FAB(CD)ABCD(AB)(CD)ABCDACBCADBDABCD

（b）图的逻辑函数式为：



F(AB)•(BC)ABACBBC ACB

六、设计题（共36分）

1、画出实现逻辑函数FABABCAC的逻辑电路。（8分） 设计：对逻辑函数式进行化简：

FABABCAC



ABACAC

ABC

10


根据上述最简式可画出逻辑电路为：

2、设计一个三变量的判偶逻辑电路，其中0也视为偶数。（10分） 设计：根据题目要求写出逻辑功能真值表如下;

A B C 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0

1 1 1

根据真值表写出逻辑函数式并化简为最简与或式如下： FACBACBABCABC

A

C A B

&

≥1

F

&

F 1 0 0 1 0 1 1 0 &

1 1 1

& & &

≥1

F



B C

3、用与非门设计一个三变量的多数表决器逻辑电路。（10分） 设计：根据题目要求写出逻辑功能真值表如下：

A B C 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1

11

F 0 0 0 1 0 1


1 1 0

1 1 1

根据真值表写出逻辑函数式并化简为最简与或式如下：

1 1

FABCABCABCABCABACBCAB•BC•AC



根据上述最简式画出相应逻辑电路图如下：

A

B C

& & &

&

F

4、用与非门设计一个组合逻辑电路，完成如下功能：只有当三个裁判（包括裁判长）或裁判长和一个裁判认为杠铃已举起并符合标准时，按下按键，使灯亮（或铃响），表示此次举重成功，否则，表示举重失败。（12分）

（a）

设计：根据题意取三个裁判分别为输入变量A、B、C，A为裁判长，设按下按键输入

A B C 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0

1 1 1

根据真值表写出逻辑函数式并化简为最简与或式如下：

F 0 0 0 0 0 1 1 1

为1，否则为0，举重成功为1，举重失败为0，据题意列出相应真值表如下：

FABCABCABCABACAB•AC



根据上述最简式画出相应逻辑电路图如下：

A &

B

12

&

F

C

&


第4单元 能力训练检测题 （共100分，120分钟）

一、填空题：（每空0.5分，共20分）

1、两个与非门构成的基本RS触发器的功能有 置0 、 置1 和 保持 。电路中不允许两个输入端同时为 低电平 ，否则将出现逻辑混乱。

2、通常把一个CP脉冲引起触发器多次翻转的现象称为 空翻 ，有这种现象的触发器是 钟控的RS 触发器，此类触发器的工作属于 电平 触发方式。

3、为有效地抑制“空翻”，人们研制出了 边沿 触发方式的 主从型JK 触发器和 维持阻塞型D 触发器。

4、JK触发器具有 置0 、 置1 、 保持 和 翻转 四种功能。欲使JK触发器实现Qn1Qn的功能，则输入端J应接 高电平1 ，K应接 高电平1 。

5、D触发器的输入端子有 1 个，具有 置0 和 置1 的功能。

6、触发器的逻辑功能通常可用 特征议程 、 状态转换图 、 功能真值表 和 时序波形图 等多种方法进行描述。

7、组合逻辑电路的基本单元是 门电路 ，时序逻辑电路的基本单元是 触发器 。 8、JK触发器的次态方程为 Qn+1=j Qn’+K’ Qn ；D触发器的次态方程为 Qn+1= Dn 。

9、触发器有两个互非的输出端Q和Q，通常规定Q=1，Q=0时为触发器的 1 状态；Q=0，Q=1时为触发器的 0 状态。

10、两个与非门组成的基本RS触发器，正常工作时，不允许RS 0 ，其特征方程为

Qn1SRQn ，约束条件为 RS1 。

11、钟控的RS触发器，在正常工作时，不允许输入端R=S= 1 ，其特征方程为

Qn1SRQn （CP1） ，约束条件为 SR=0 。

12、把JK触发器 两个输入端子连在一起作为一个输入 就构成了T触发器，T触发器具有的逻辑功能是 保持 和 翻转 。

13、让 T 触发器恒输入“1”就构成了T'触发器，这种触发器仅具有 翻转 功能。

二、正误识别题（每小题1分，共10分）

1、仅具有保持和翻转功能的触发器是RS触发器。 （ 错 ） 2、基本的RS触发器具有“空翻”现象。 （ 错 ） 3、钟控的RS触发器的约束条件是：R＋S=0。 （ 错 ） 4、JK触发器的特征方程是：Qn1JQKQn。 （ 错 ） 5、D触发器的输出总是跟随其输入的变化而变化。 （ 对 ） 6、CP=0时，由于JK触发器的导引门被封锁而触发器状态不变。 （ 对 ）

13

n


7、主从型JK触发器的从触发器开启时刻在CP下降沿到来时。 （ 对 ） 8、触发器和逻辑门一样，输出取决于输入现态。 （ 错 ） 9、维持阻塞D触发器状态变化在CP下降沿到来时。 （ 错 ） 10、凡采用电位触发方式的触发器，都存在“空翻”现象。 （ 错 ） 三、选择题（每小题2分，共20分）

1、仅具有置“0”和置“1”功能的触发器是（ C ）。

A、基本RS触发器 B、钟控RS触发器 C、D触发器 D、JK触发器

2、由与非门组成的基本RS触发器不允许输入的变量组合SR为（ A ）。

A、00 B、01 C、10 D、11 3、钟控RS触发器的特征方程是（ D ）。 A、Qn1RQn B、Qn1SQn C、Qn1RSQn D、Qn1SRQn 4、仅具有保持和翻转功能的触发器是（ B ）。

A、JK触发器 B、T触发器 C、D触发器 D、Tˊ触发器 5、触发器由门电路构成，但它不同门电路功能，主要特点是具有（ C ）

A、翻转功能 B、保持功能 C、记忆功能 D、置0置1功能 6、TTL集成触发器直接置0端RD和直接置1端SD在触发器正常工作时应（ C A、RD=1，SD=0 B、RD=0，SD=1 C、保持高电平“1” D、保持低电平“0” 7、按触发器触发方式的不同，双稳态触发器可分为（ C ）

A、高电平触发和低电平触发 B、上升沿触发和下降沿触发 C、电平触发或边沿触发 D、输入触发或时钟触发 8、按逻辑功能的不同，双稳态触发器可分为（ D ）。

A、RS、JK、D、T等 B、主从型和维持阻塞型 C、TTL型和MOS型 D、上述均包括 9、为避免“空翻”现象，应采用（ B ）方式的触发器。

A、主从触发 B、边沿触发 C、电平触发 10、为防止“空翻”，应采用（ C ）结构的触发器。

A、TTL B、MOS C、主从或维持阻塞

四、简述题（每小题3分，共15分）

1、时序逻辑电路的基本单元是什么？组合逻辑电路的基本单元又是什么？ 答：时序逻辑电路的基本单元是触发器，组合逻辑电路的基本单元是门电路。 2、何谓“空翻”现象？抑制“空翻”可采取什么措施？

1

4

）
答：在时钟脉冲CP＝1期间，触发器的输出随输入发生多次翻转的现象称为空翻。抑制空翻的最好措施就是让触发器采取边沿触发方式。

3、触发器有哪几种常见的电路结构形式？它们各有什么样的动作特点？

答：触发器常见的结构形式有①与非门构成的基本RS触发器，其动作特点是：输入信号在电平触发的全部作用时间里，都能直接改变输出端Q的状态；②钟控的RS触发器，其动作特点：当CP=0时，无论两个输入端R和S如何，触发器的状态不能发生改变；只有当作为同步信号的时钟脉冲到达时，触发器才能按输入信号改变状态；③主从型JK触发器，其动作特点：主从型JK触发器的状态变化分两步动作。第1步是在CP为“1”期间主触发器接收输入信号且被记忆下来，而从触发器被封锁不能动作；第2步是当CP下降沿到来时，从触发器被解除封锁，接收主触发器在CP为1期间记忆下来的状态作为控制信号，使从触发器的输出状态按照主触发器的状态发生变化；之后，由于主触发器在CP＝0期间被封锁状态不再发生变化，因此，从触发器也就保持了CP下降沿到来时的状态不再发生变化。即主从型JK触发器的输出状态变化发生在CP脉冲的下降沿。

主触发器本身是一个钟控的RS触发器，因此在CP＝1的全部期间都受输入信号的控制，即存在“空翻”现象。但是，只有下降沿到来前的主触发器状态，才是改变从触．．．

发器状态的控制信号，而下降沿到达时刻的主触发器状态不一定是从触发器的控制信号；④维持阻塞型D触发器，其动作特点：维持阻塞D触发器的次态仅取决于CP信号上升沿到达前一瞬间（这一时刻与上升沿到达时的间隔趋近于零）输入的逻辑状态，而在这一瞬间之前和之后，输入的状态变化对输出不能够并生影响。

4、试分别写出钟控RS触发器、JK触发器和D触发器的特征方程。

答：钟控RS触发器的特征方程：Qn1SRQn ，SR=0（约束条件）； （CP1）JK触发器的特征方程：Qn1JQnKQn； D触发器的特征方程：Q n +1= D n。 5、你能否推出由两个或非门组成的基本RS触发器的功能？写出其真值表。 答：由两个或非门组成的基本RS触发器如图所示，其功能与钟控RS触发器相同，所不同点是或非门构成的基本RS触发器是电平触发方式，没有时钟脉冲控制。

功能真值表也与钟控RS触发器完全相同。

五、分析题（共35分）

1、已知TTL主从型JK触发器的输入控制端J和K及CP脉冲波形如图4.23所示，

15

QQ

≥1

门1 ≥1 门2

R S

或非门构成的基本RS触发器


试根据它们的波形画出相应输出端Q的波形。（6分）

CP J K 解：

CP

J

K

Q

图4.23 检测题4.5.1波形图



2、写出图4.24所示各逻辑电路的次态方程。（每图2分，共12分） 解：（a）图：Qn1A （b）图：Qn1Dn （c）图：Qn1Qn （d）图：Qn1Qn （e）图：Qn1Qn （f）图：Qn1Qn

A CP

1D C1 （a）

1 CP

1J C1 1K （d）

Q

CP

Q

CP

1D C1 （b） 1J C1 1K （e）

Q

CP

Q

CP

1D C1 （c） 1J C1 1K （f）

Q Q

图4.24检测题4.5.2逻辑图

3、图4.25所示为维持阻塞D触发器构成的电路，试画出在CP脉冲下Q0和Q1的波形。（9分）



16

Q0

CP

1D C1



Q

1D C1

Q1

Q

Q Q

图4.25 检测题4.5.3逻辑图






解：Q0n+1=Q0，Q1n+1=Q1，设触发器初态为00，各位触发器在CP上升沿触发。 显然在每一个CP脉冲上升沿到来时，触发器Q0状态就翻转一次，而触发器Q1的状态翻转发生在Q0由0到1时刻。图略。

4、电路如图4.26所示：

(1) 图示电路中采用什么触发方式；

(2) 分析下图所示时序逻辑电路，并指出其逻辑功能；

(3) 设触发器初态为0，画出在CP脉冲下Q0和Q1的波形。（8分）

“1” CP

J Q

C

K Q

Q J C

K Q

Q0

Q1

nn

RD

图4.26 检测题4.5.4逻辑图

解：①JK触发器采用的都是边沿触发方式； ②分析电路：

电路驱动方程：J0＝K0＝1，J1＝K1＝Q0， 将驱动方程代入触发器的特征方程可得：Q0功能真值表：

Q1n Q0n 0 0 0 1 1 0 1 1

由功能真值表可看出，这是一个2位四进制加计数器。 ③电路初态为0，画出其时序波形图如下： CP

17

n1

Q0，Q1

nn1

Q0Q1Q0Q1。

nnnn

Q1n+1 Q0n+1 0 1 1 0 1 1 0 0

Q0 Q1




18

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